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pruefungen:hauptstudium:ls3:cpu-vhdl-2022-08-11 [11.08.2022 13:04] – ic14acin | pruefungen:hauptstudium:ls3:cpu-vhdl-2022-08-11 [11.08.2022 13:05] – ic14acin | ||
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*Wie sieht es mit 1. Takt und 2. Ressourcenverbrauch aus, wenn wir 1. die Anzahl der Register auf 64 erhöhen oder 2. die breite der Register auf 64 erhöhen. | *Wie sieht es mit 1. Takt und 2. Ressourcenverbrauch aus, wenn wir 1. die Anzahl der Register auf 64 erhöhen oder 2. die breite der Register auf 64 erhöhen. | ||
> Wahrscheinlich längste Antwort/ | > Wahrscheinlich längste Antwort/ | ||
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==== Pipelining und IPC Steigerung ==== | ==== Pipelining und IPC Steigerung ==== | ||